QFP208 Xilinx espartano 3 FPGA XC3S400 XC3S1000 XC3S1500 XC3S2000 XC3S4000

Serie completa FPGA ICs de XILINX QFP208 Spartan-3 XC3S200-4PQG208I XC3S400 XC3S1000 XC3S1500 XC3S2000 XC3S4000 XC3S5000

Entrada-salida Spartan-3 IC FPGA XC3S200-4PQG208I de XILINX QFP208 141

Introducción:

La familia de Spartan®-3A de órdenes de puerta Campo-programables (FPGAs) soluciona los desafíos del diseño en la mayoría del en grandes cantidades, coste-sensible, los usos electrónicos de I/O-intensive. La familia del cinco-miembro ofrece las densidades que se extienden de 50.000 a 1,4 millones las puertas del sistema, tal y como se muestra en del cuadro 1. Los Spartan-3A FPGAs son parte de la familia extendida de Spartan-3A, que también incluyen el Spartan-3AN permanente y el Spartan-3A más de alta densidad DSP FPGAs. La familia de Spartan-3A emplea el éxito de las familias anteriores de Spartan-3E y de Spartan-3 FPGA. Las nuevas características mejoran funcionamiento de sistema y reducen el coste de la configuración. Estos aumentos de la familia de Spartan-3A, combinados con tecnología de proceso probada de 90 nanómetro, entregan más función y ancho de banda por dólar que nunca antes, fijando el nuevo estándar en la industria programable de la lógica. Debido a su costo excepcionalmente bajo, Spartan-3A FPGAs se adaptan idealmente a una amplia gama de usos de los productos electrónicos de consumo, incluyendo el acceso de banda ancha, el establecimiento de una red casero, la exhibición/la proyección, y el equipo de televisión digital. La familia de Spartan-3A es una alternativa superior a enmascarar programó Asics. FPGAs evita el alto coste inicial, los ciclos de desarrollo muy largos, y la inflexibilidad inherente de Asics convencional, y de las mejoras del diseño del campo del permiso.

Características:

• Costo muy bajo, solución de alto rendimiento de la lógica para los usos en grandes cantidades, conscientes sobre costos

• la fuente de la Dual-gama VCCAUX simplifica el diseño 3.3V-only

• Suspenda, hiberne los modos para reducir poder del sistema

• Multi-voltaje, pernos multi-estándar del interfaz de SelectIO™

• Hasta 502 pernos de la entrada-salida o 227 pares de la señal diferenciada

• LVCMOS, LVTTL, HSTL, y entrada-salida de terminación única de SSTL

• señalización 3.3V, 2.5V, 1.8V, 1.5V, y 1.2V

• Impulsión a elección de la salida, hasta 24 mA por el perno

• El estándar de QUIETIO reduce ruido que cambia de la entrada-salida

• 3.3V compatibilidad completa del ± el 10% y conformidad caliente del intercambio.

• Tasa de transferencia de los datos de 640+ Mb/s por la entrada-salida diferenciada

• LVDS, RSDS, mini-LVDS, entrada-salida diferenciada de HSTL/SSTL con los resistores diferenciados integrados de la terminación

• Ayuda doble aumentada de la tarifa de datos (RDA)

• Ayuda de DDR/DDR2 SDRAM hasta 400 Mb/s

• 32-/64-bit completamente obediente, 33/66 megaciclo de PCI® de ayuda de tecnología

• Recursos abundantes, flexibles de la lógica • Las densidades hasta 25.344 células de la lógica, incluyendo el registro de cambio opcional o distribuyeron la ayuda de RAM

• Multiplexores anchos eficientes, lógica amplia

• Rápido anticipe llevan lógica

• 18 x 18 multiplicadores aumentados con la tubería opcional

• Programación/eliminar errores de IEEE 1149.1/1532 JTAG del puerto

• Arquitectura jerárquica de la memoria de SelectRAM™

• Hasta 576 Kbits del bloque rápido RAM con byte escriben permite para los usos del procesador

• Hasta 176 Kbits de RAM distribuido eficiente

• Hasta ocho encargados de reloj de Digitaces (DCMs)

• Eliminación oblicua del reloj (lazo bloqueado del retraso)

• Síntesis de la frecuencia, multiplicación, división

• Defasador de alta resolución

• Gama de frecuencia ancha (5 megaciclos a más de 320 megaciclos)

• Ocho redes globales del reloj de la bajo-posición oblicua, ocho relojes cionales por el medio dispositivo, más la encaminamiento abundante de la bajo-posición oblicua

• Interfaz de la configuración a los bailes de fin de curso del estándar industrial

• Barato, BAILE DE FIN DE CURSO de destello serial de SPI del ahorro de espacio

• paralelo de x8 o de x8/x16 BPI NI BAILE DE FIN DE CURSO de destello

• Flash barato de la plataforma de Xilinx® con JTAG

• Identificador único de la DNA del dispositivo para la autentificación del diseño

• Bitstreams múltiples de la carga bajo control de FPGA

• comprobación del CRC de la Poste-configuración

• Ayuda del software del sistema de desarrollo completo de Xilinx ISE® y de WebPACK™ más equipo del arrancador de Spartan-3A

• El  de MicroBlaze™ y de PicoBlaze integró procesadores

• QFP barato y BGA que empaquetan, opciones Pb-libres

• Las huellas comunes apoyan la migración fácil de la densidad

• Compatible con Spartan-3AN selecto FPGAs permanente

• Compatible con un Spartan-3A más de alta densidad DSP FPGAs

• Versión automotriz de la XA disponible

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XC3S2000 los 2M 46.080 80 64 5.120 320K 720K 40 4 565 270

XC3S4000 los 4M 62.208 96 72 6.912 432K 1,728K 96 4 633 300

XC3S5000 los 5M 74.880 104 80 8.320 520K 1,872K 104 4 633 300

Para más información sobre la disponibilidad común de la familia de Spartan-3A FPGA, no dude en enviar por favor el correo electrónico: sales@icschip.com

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