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Dispositivo de lógica programable de IC max 7000A de los circuitos integrados de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Categoría:
CI de circuitos integrados
Precio:
Negotiated
Forma de pago:
T/T, Western Union
Especificaciones
Familia de IC:
CPLDs (dispositivos de lógica programable complejos) IC
Descripción:
CI CPLD 64MC 10NS 44TQFP
Categoría:
componentes electrónicos
Nombre de productos:
Circuitos integrados (IC) - Dispositivo lógico programable MAX 7000A
Nombre de la parte base:
EPM7064
Paquete:
QFP44
Tipo programable:
En el sistema programable
Piezas relacionadas:
EPM7032AE EPM7064AE EPM7128AE EPM7256AE EPM7512AE
Situación sin plomo:
RoHS obediente, PB libre, sin plomo
Usos:
Los transmisores-receptores de baja potencia RS-422 de los transmisores-receptores de baja potencia
Introducción

Circuitos integrados IC de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Dispositivo de lógica programable del max 7000A

Part# relacionado EPM7032AE EPM7064AE EPM7128AE EPM7256AE EPM7512AE CPLD INTEL IC

La arquitectura del max 7000A incluye los elementos siguientes:

Términos del producto del ampliador del ■ de Macrocells del ■ de los bloques del arsenal de lógica (laboratorios) (compartible y paralelo)

■Arsenal programable de la interconexión

■Entrada-salida bloque de gestión la arquitectura del max 7000A incluye cuatro entradas dedicadas que se puedan utilizar como entradas de fines generales

o como las señales de control de alta velocidad, globales (reloj, claro, y salida dos permitir señales) para cada macrocell y el perno de la entrada-salida.

Características:

3.3-V de alto rendimiento EEPROM-basó los dispositivos de lógica programable (PLDs) empleó arquitectura múltiple de segunda generación de la matriz del arsenal (MAX®) (véase el cuadro 1)

■programabilidad del en-sistema 3.3-V (ISP) a través del interfaz común del grupo de acción de prueba del estándar 1149,1 incorporados de IEEE (JTAG) con capacidad de perno-fijación avanzada – conjunto de circuitos de la programabilidad del en-sistema del dispositivo del max 7000AE (ISP) obediente con el estándar 1532 de IEEE – conjunto de circuitos de la ISP del dispositivo de EPM7128A y de EPM7256A compatible con el estándar 1532 de IEEE

■Conjunto de circuitos incorporado de la prueba de la límite-exploración (BST) obediente con el estándar 1149,1 de IEEE

■Apoya la prueba estándar y el lenguaje de programación (STAPL) JESD-71 del atasco de JEDEC

■La ISP aumentada ofrece – algoritmo aumentado de la ISP para una programación más rápida (excepto los dispositivos de EPM7128A y de EPM7256A) – el pedazo de ISP_Done para asegurar la programación completa (excepto los dispositivos de EPM7128A y de EPM7256A) – levanta el resistor en los pernos de la entrada-salida durante la programación del en-sistema

■Pin-compatible con el ■ popular PLDs de alta densidad de los dispositivos de 5.0-V max 7000S que se extiende de 600 a 10.000 puertas usables

■Gama de temperaturas extendida

retrasos de la lógica del perno-a-perno 4.5-ns con frecuencias contrarias de hasta 227,3 megaciclos

■El interfaz de la entrada-salida de MultiVoltTM permite base del dispositivo al funcionamiento en 3,3 V, mientras que los pernos de la entrada-salida son compatibles con los niveles de la lógica 5.0-V, 3.3-V, y 2.5-V

■Cuentas de Pin que se extienden de 44 a 256 en una variedad de paquete plano del patio fino (TQFP), el paquete plano del patio plástico (PQFP), el arsenal de la bola-rejilla (BGA), el ahorro de espacio BGATM FineLine, y los paquetes plásticos del portador de microprocesador de la J-ventaja (PLCC)

■Ayudas calientes-socketing en dispositivos del max 7000AE

■Estructura de encaminamiento continua programable del arsenal de la interconexión (PIA) para la arquitectura Autobús-amistosa del funcionamiento del ■ PCI-compatible rápido, fiable del ■, incluyendo la opción de salida programable del Abierto-dren del ■ del control de la ciénaga-tarifa

■El macrocell programable se registra con claro individual, preestablecido, reloj, y el reloj permite controles

■Los estados de ciclo inicial programables para los registros del macrocell en el modo programable del poder-ahorro del ■ de los dispositivos del max 7000AE para el 50% o la reducción del mayor poder en cada distribución configurable del producto-término del ampliador del ■ del macrocell, permitiendo hasta 32 términos del producto por el pedazo programable de la seguridad del ■ del macrocell para la protección del ■ propietario 6 a de los diseños la salida del perno 10 o lógica-conducida permiten el ■ dos de las señales que ayunan las señales de reloj globales con el ■ opcional de la inversión aumentaron los recursos de la interconexión para el ■ mejorado del routability los tiempos de disposición de la entrada proporcionados por una trayectoria dedicada del perno de la entrada-salida a los pernos de tierra programables de la salida del ■ de los registros del macrocell de la ciénaga-tarifa del ■ programable del control

La ayuda del diseño de software y la lugar-y-ruta automática proporcionada por los sistemas del desarrollo de Altera para las PC basadas en Windows y Sun SPARCstation, y HP 9000 series 700/800 ayuda■ adicional de la entrada y de la simulación del diseño de los puestos de trabajo proveyeron por EDIF 2 de 0 0 y 3 ficheros de 0 0 netlist, de la biblioteca de los módulos dados parámetros (LPM), de Verilog HDL, VHDL, y otros interfaces a las herramientas populares de EDA de fabricantes tales como ayuda de programación del ■ de la cadencia, de la lógica del modelo, de los gráficos del mentor, de OrCAD, de Synopsys, de Synplicity, y de VeriBest el serial principal de la unidad (MPU), de MasterBlasterTM de la programación de Altera/el cable de las comunicaciones del bus de serie universal (USB), cable de la transferencia directa del puerto paralelo de ByteBlasterMVTM, y cable serial de la transferencia directa de BitBlasterTM, así como programación hardware de fabricantes de tercera persona y de cualquier fichero de JamTM STAPL (.jam), del fichero del Byte-código del atasco (.jbc), o del probador capaz serial del en-circuito del fichero del formato del vector (.svf).

Hoja de datos del dispositivo de lógica programable del max 7000A:

Programabilidad del En-sistema

Los dispositivos del max 7000A pueden ser en-sistema programado vía 4 un interfaz industrystandard del estándar 1149,1 de IEEE del perno (JTAG). La ISP ofrece iteraciones rápidas, eficientes durante el desarrollo del diseño y los ciclos de la eliminación de errores. La arquitectura del max 7000A internamente genera los altos voltajes programados requeridos para programar las células de EEPROM, permitiendo el en-sistema que programa con solamente una sola fuente de alimentación 3.3-V. Durante el en-sistema que programa, los pernos de la entrada-salida tri se indican y se levantan débil para eliminar conflictos del tablero. Levante el valor es nominal el kΩ 50. Los dispositivos del max 7000AE tienen un algoritmo aumentado de la ISP para más rápidamente programar. Estos dispositivos también ofrecen un pedazo de ISP_Done que proporcione la operación segura cuando se interrumpe la programación del en-sistema. Este pedazo de ISP_Done, que es el pedazo pasado programó, evita que todos los pernos de la entrada-salida conduzcan hasta que se programe el pedazo. Esta característica está solamente disponible en dispositivos de EPM7032AE, de EPM7064AE, de EPM7128AE, de EPM7256AE, y de EPM7512AE. La ISP simplifica el flujo de fabricación permitiendo que los dispositivos sean montados en un PWB con el equipo estándar del selección-y-lugar antes de que se programen. Los dispositivos del max 7000A se pueden programar transfiriendo la información vía los probadores del en-circuito, procesadores integrados, las comunicaciones de Altera MasterBlaster serial/USB telegrafían, cable de la transferencia directa del puerto paralelo de ByteBlasterMV, y cable serial de la transferencia directa de BitBlaster. La programación de los dispositivos después de que se pongan en el tablero elimina daño de la ventaja en los paquetes de la alto-perno-cuenta (e.g., paquetes de QFP) debido a la dirección del dispositivo. Los dispositivos del max 7000A pueden ser reprogramados después de que un sistema haya enviado ya al campo. Por ejemplo, las mejoras de producto se pueden realizar en el campo vía software o el módem. la programación del En-sistema se puede lograr con un algoritmo adaptante o constante. Un algoritmo adaptante lee la información de la unidad y adapta pasos de programación subsiguientes para alcanzar la época programada posible más rápida para esa unidad. Un algoritmo constante utiliza una secuencia programada (no-adaptante) predefinida que no se aproveche de mejoras programadas del tiempo del algoritmo adaptante. Algunos probadores del en-circuito no pueden programa usando un algoritmo adaptante. Por lo tanto, un algoritmo constante debe ser utilizado. Los dispositivos del max 7000AE se pueden programar con un algoritmo (no-adaptante) adaptante o constante. El dispositivo de EPM7128A y de EPM7256A se puede programar solamente con un algoritmo adaptante; la programación de usuarios estos dos dispositivos en las plataformas que no pueden utilizar un algoritmo adaptante debe utilizar los dispositivos de EPM7128AE y de EPM7256AE. La prueba y el lenguaje de programación (STAPL), estándar JESD 71 del estándar del atasco de JEDEC, se pueden utilizar para programar los dispositivos del max 7000A con los probadores del incircuit, las PC, o los procesadores integrados.

Dispositivo de lógica programable de IC max 7000A de los circuitos integrados de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Dispositivo de lógica programable de IC max 7000A de los circuitos integrados de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Dispositivo de lógica programable de IC max 7000A de los circuitos integrados de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Dispositivo de lógica programable de IC max 7000A de los circuitos integrados de EPM7064AETC44-10N ALTERA CPLD 64MC 10NS 44TQFP

Control programable de la velocidad/de poder

Los dispositivos del max 7000A ofrecen un modo del poder-ahorro que apoye la operación de baja potencia a través de las rutas de la señal definidas por el usario o del dispositivo entero. Esta característica permite que la disipación de poder total sea reducida por el 50% o más porque la mayoría de los usos de la lógica requieren solamente una pequeña parte de todas las puertas actuar en la frecuencia máxima. El diseñador puede programar por cada uno el macrocell individual en un dispositivo del max 7000A para cualquier operación de alta velocidad (es decir, con la opción de Turbo BitTM se giró) o de baja potencia (es decir, con la opción del pedazo de Turbo apagó). Como consecuencia, las trayectorias velocidad-críticas en el diseño pueden correr en la velocidad, mientras que las trayectorias restantes pueden actuar en el poder reducido. Macrocells que funcionamiento en la energía baja incurrir en una serpiente nominal del retraso (tLPA) para el tLAD, el tLAC, el tic, los diez, el tSEXP, el tACL, y los parámetros del tCPPW.

Clasificaciones ambientales y de la exportación

CUALIDAD DESCRIPCIÓN
Situación de RoHS ROHS3 obediente
Nivel de la sensibilidad de humedad (MSL) 1 (ilimitado)
Situación del ALCANCE ALCANCE inafectado
ECCN EAR99
HTSUS 8542.39.0001

Especificaciones:

Categoría
Componentes electrónicos
Subcategoría
Circuitos integrados IC
Familia
CPLDs (dispositivos de lógica programable complejos) IC
Mfr
ALTERA/INTEL
Paquete
Bandeja y carrete (TR)
Tipo
Transmisor-receptor
Protocolo
RS422, RS485
Número de conductores/de receptores
1 /.1
Duplex
Lleno
Histéresis del receptor
70 milivoltio
Tarifa de datos
250kbps
Voltaje - fuente
3V ~ 3.6V
Temperatura de funcionamiento
-40°C~70°C(TA)
Montaje del tipo
Soporte superficial
Paquete/caso
QFP44 (10* 10m m)
Paquete del dispositivo del proveedor
TQFP44
Número bajo del producto
EPM7064
Productos relacionados Ficha-pdf EPM7032AE EPM7064AE EPM7128AE EPM7256AE EPM7512AE

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Cuota de producción:
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